Tecnología FET y MOSFET Mejías Rubén
INTRODUCCIÓN El FET es un dispositivo semiconductor que controla un flujo de corriente por un canal semiconductor, aplicando un campo eléctrico perpendicular a la trayectoria de la corriente. El FET está compuesto de una parte de silicio tipo N, a la cual se le adicionan dos regiones con impurezas tipo P llamadas compuerta (gate) y que están unidas entre si. Ver la figura Los terminales de este tipo de transistor se llaman Drenador (drain), Fuente (source) y el tercer terminal es la compuerta (gate) que ya se conoce. La región que existe entre el drenador y la fuente y que es el camino obligado de los electrones se llama "canal". La corriente circula de Drenaje (D) Fuente (S). Ver el gráfico. Este tipo de transistor se polariza de manera diferente al transistor bipolar. El terminal de drenaje se polariza positivamente con respecto al terminal de fuente (Vdd) y la compuerta o gate se polariza negativamente con respecto a la fuente (-Vgg). A mayor voltaje -Vgg, más angosto es el canal y más difícil para la corriente pasar del terminal drenador (drain) al terminal fuente o source. La tensión -Vgg para la que el canal queda cerrado se llama "punch-off" y es diferente para cada FET
FET Canal N
FET Canal P
El transistor de juntura bipolar es un dispositivo operado por corriente y requieren que halla cambios en la corriente de base para producir cambios en la corriente de colector. El FET es controlado por tensión y los cambios en tensión de la compuerta (gate) a fuente (Vgs) modifican la región de rarefacción y causan que varíe el ancho del canal.
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MOSFET: Metal Oxide Semiconductor Field Effect Transistor MOSFET significa "FET de Metal Oxido Semiconductor" o FET de compuerta aislada Es un tipo especial de transistor FET que tiene una versión NPN y otra PNP. El NPN es llamado MOSFET de canal N y el PNP es llamado MOSFET de canal P. Una delgada capa de material aislante formada de dióxido de silicio (SiO 2 ) (también llamada "sílice" o "sílica") es colocada del lado del semiconductor y una capa de metal es colocada del lado de la compuerta (GATE) (ver la figura) En el MOSFET de canal N la parte "N" está conectado a la fuente (source) y al drenaje (drain) En el MOSFET de canal P la parte "P" está conectado a la fuente (source) y al drenaje (drain) En los transistores bipolares la corriente que circula por el colector es controlada por la corriente que circula por la base. Sin embargo en el caso de los transistores FET, la corriente de salida es controlada por una tensión de entrada (un campo eléctrico). En este caso no existe corriente de entrada. Los transistores MOSFET se pueden dañar con facilidad y hay que manipularlos con cuidado. Debido a que la capa de óxido es muy delgada, se puede destruir con facilidad si hay alta tensión o hay electricidad estática.
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Ventajas y desventajas del FET Las ventajas del FET pueden resumirse como sigue: Ω Son dispositivos sensibles a la tensión con alta impedancia de entrada (del orden de 107 W). Como esta impedancia de entrada es considerablemente mayor que la de los BJT, se prefieren los FET a los BJT para la etapa de entrada de un amplificador multietapa. Ω Los FET generan un nivel de ruido menor que los BJT. Ω Los FET so más estables con la temperatura que los BJT. Ω Los FET son, en general, más fáciles de fabricar que los BJT pues suelen requerir menos pasos de enmascaramiento y difusiones. Es posible fabricar un mayor número de dispositivos en un circuito integrado (es decir, puede obtener una densidad de empaque mayor). Ω Los FET se comportan como resistores variables controlados por tensión para valores pequeños de tensión de drenaje a fuente. Ω La alta impedancia de entrada de los FET les permite almacenar carga el tiempo suficiente para permitir su utilización como elementos de almacenamiento. Ω Los FET de potencia pueden disipar una potencia mayor y conmutar corrientes grandes. Existen varias desventajas que limitan la utilización de los FET en algunas aplicaciones: Ω Los FET exhiben una respuesta en frecuencia pobre debido a la alta capacitancia de entrada. Ω Algunos tipos de FET presentan una linealidad muy pobre. Ω Los FET se pueden dañar al manejarlos debido a la electricidad estática.
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Tipos de FET Se consideran tres tipos principales de FET: Ω FET de unión (JFET) Ω FET
metal
óxido
semiconductor
de
empobrecimiento
(MOSFET
de
empobrecimiento) Ω FET metal óxido semiconductor de enriquecimiento (MOSFET de enriquecimiento) Con frecuencia el MOSFET se denomina FET de compuerta aislada (IGFET, insulated-gate FET). Operación y construcción del JFET Al igual que el BJT, el FET es un dispositivo de tres terminales, pero solo tiene una unión pn en vez de dos, como en el BJT. El JFET de canal n, mostrado en la figura 4.1(a), se construye utilizando una cinta de material de tipo n con dos materiales de tipo p difundidos en ella, uno en cada lado. El JFET de canal p tiene una cinta de material de tipo p con dos materiales de tipo n difundidos en ella, como se muestra en la figura 4.1(b).
Para entender la operación del JFET, se conecta el JFET de canal n de la figura 4.1(a) a un circuito externo. Se aplica una fuente de tensión, VDD, al drenaje (esta es análoga a la fuente de tensión VCC para el BJT) y se envía a tierra. Una fuente de tensión de compuerta, VGG, se aplica a la compuerta (aquella es análoga a la VBB para el BJT). Esta configuración se muestra en la figura 4.2(a).
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VDD proporciona una tensión drenaje a fuente, vDS, que provoca una corriente de drenaje, iD, del drenaje a la fuente. La corriente de drenaje, iD, que es identica a la corriente de fuente, existe en el canal rodeado por la compuerta de tipo p. La tensión compuerta a fuente, vGS, que es igual a –VGG crea una region desertica en el canal, que reduce el ancho de este y por tanto aumenta la resistencia entre drenaje y fuente. Como la unión compuerta –fuente esta polarizada en inverso, el resultado es una corriente de compuerta nula. Variación de la tensión compuerta a fuente en el FET El Fet es un dispositivo controlado por tensión y se controla mediante vGS. En la figura 4.4 se muestran las curvas características iD-vDS tanto para un JFET de canal n como para uno de canal p.
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Antes de analizar estas curvas, tómese nota de los símbolos para los JFET de canal n y de canal p, que también se muestran en la figura 4.4. Estos simbolos son iguales excepto por la dirección de la flecha. Conforme se incrementa vGS (más negativo para un canal n y más positivo para un canal p) se forma la región desértica y se cierra para un valor menor que iD. Por tanto, para el JFET de canal n de la figura 4.4(a), la iD máxima se reduce desde IDSS conforme vGS se hace más negativo. Si vGS disminuye aun más (más negativo), se alcanza un valor de vGS, después del cual iD será cero sin importar el valor de vDS. Este valor de vGS se denomina VGSOFF, o tensión de estrangulamiento (VP). El valor de VP es negativo para un JFET de canal n y positivo para un JFET de canal p. Características de transferencia del JFET De gran valor en el diseño con JFET es la característica de transferencia, que es una gráfica de la corriente de drenaje, iD, como función de la tensión compuerta a fuente, vGS, por encima del estrangulamiento. Un método útil de determinar la característica de transferencia es con ayuda de la siguiente relación (ecuación de Shockley):
(4.1) Por tanto, solo se necesita conocer IDSS y VP, y toda la característica quedara determinada. Las hojas de datos de los fabricantes a menudo dan estos dos parámetros, por la que se puede construir la característica de transferencia o utilizar la ecuación 4.1 directamente. El parámetro de control para el FET es la tensión compuerta-fuente en lugar de la corriente de base, como en el BJT. La región entre el estrangulamiento y la ruptura por avalancha se denomina región activa, región de operación del amplificador, región de saturación o región de estrangulamiento, como se muestra en la figura 4.5.
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La región ohmica (antes del estrangulamiento) a veces se denomina región controlada por tensión. El FET opera en esta región cuando se desea un resistor variable y en aplicaciones de conmutación. La tensión de ruptura es función de vGS así como de vDS. Conforme aumenta la magnitud entre compuerta y fuente (más negativa para el canal n y más positiva para el canal p), disminuye la tensión por ruptura. Con vGS = VP, la corriente de drenaje es cero (excepto por una pequeña corriente de fuga), y con vGS = 0, la corriente de drenaje se satura a un valor iD = IDSS Donde IDSS es la corriente de saturación drenaje a fuente. Circuito equivalente, gm y rDS Para obtener una medida de la amplificación posible con un JFET, se introduce el parámetro gm, que es la transconductancia en directo. Este parámetro es similar a la ganancia en corriente (o hfe) para un BJT. El valor de gm, que se mide en siemens (S), es una medida del cambio en la corriente de drenaje para un cambio en la tensión compuertafuente. Esto se puede expresar como
(4.2)
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Se puede encontrar la transconductancia diferenciando la ecuación (4.1), lo que da como resultado
(4.3) La resistencia dinámica en inverso, rDS, se define como el inverso de la pendiente de la curba iD-vDS en la región de saturación:
(4.7) El desempeño de un JFET esta especificado por lo valores de gm y rDS. Estos parámetros se determinan ahora para un JFET de canal n utilizando la curva característica de la figura 4.7.
Si las curvas caracteristicas para el FET no están disponibles, gm y vGS se pueden obtener matemáticamente, siempre que se conozcan IDSS y VP. Por lo general, estos dos parámetros se incluyen en las especificaciones del fabricante. Se puede seleccionar una corriente de drenaje estática, IDQ, que se halle entre 0.3 y 0.7 veces IDSS, lo cual ubica el punto Q en la región más lineal de las curvas características.
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Operación y construcción del MOSFET En esta sección, se considera el FET de metal –óxido semiconductor (MOSFET). Este FET se construye con la terminal de compuerta aislada del canal con el dieléctrico dióxido de silicio (SiO2), y ya sea en modo de empobrecimiento o bien de enriquecimiento. Estos dos tipos se definen y consideran en las siguientes secciones. MOSFET de empobrecimiento Las construcciones de los MOSFET de empobrecimiento de canal n y de canal p se muestran en las figuras 4.9 y 4.10, respectivamente.
En cada una de estas figuras se muestra la construcción, el símbolo, la característica de transferencia y las características iD-vGS. El MOSFET de empobrecimiento se construye (como se muestra en la figura 4.9(a) para el de canal n y en la figura 4.10(a) para el de canal p) con un canal físico construido entre el drenaje y la fuente. Como resultado de ello, existe una iD entre drenaje y fuente cuando se aplica una tensión, vDS. El MOSFET de empobrecimiento de canal n de la figura 4.9 se establece en un sustrato p, que es silicio contaminado de tipo p. Las regiones contaminadas de tipo n de la fuente y el drenaje forman conexiones de baja resistencia entre los extremos del canal n y los contactos de aluminio de la fuente (S) y el drenaje (D). Se hace crecer una capa de SiO2, que es un aislante, en la parte superior del canal n, como se muestra en la figura 4.9(a). Se deposita una capa de aluminio sobre el aislante de SiO2 para formar el material de compuerta (G).
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El desempeño del MOSFET de empobrecimiento, es similar al del JFET, como puede verse en las figuras 4.9(C) y 4.10(C). El JFET se controla por la unión pn entre la compuerta y el extremo de drenaje del canal. No existe dicha unión en el MOSFET enriquecimiento, y la capa de SiO2 actúa como aislante. Para el MOSFET de canal n, mostrado en la figura 4.9, una vGS negativa saca los electrones de la región del canal, empobreciéndolo. Cuando vGS alcanza VP, el canal se estrangula. Los valores positivos de vGS aumentan el tamaño del canal, dando por resultado un aumento en la corriente de drenaje. Esto se indica en las curvas características de la figura 4.9(C). MOSFET de enriquecimiento El MOSFET de enriquecimiento difiere del MOSFET de empobrecimiento en que no tiene
la capa delgada de material n sino que requiere de una tensión positiva entre la compuerta y la fuente para establecer un canal. Este canal se forma por la acción de una tensión positiva compuerta a fuente, vGS, que atrae electrones de la región de sustrato ubicada entre el drenaje y la compuerta contaminados de tipo n. Una vGS positiva provoca que los electrones se acumulen en la superficie inferior de la capa de oxido. Cuando la tensión alcanza el valor de umbral, VT, han sido atraídos a esta región los electrones suficientes para que se comporte como canal n conductor. No habrá una corriente apreciable iD hasta que vGS excede VT.
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La corriente de drenaje en saturación se puede calcular de la ecuación
(4.10) Polarización de los FET Los mismos circuitos básicos que se utilizan para polarizar los BJT se pueden emplear para los JFET y los MOSFET de empobrecimiento, la polaridad de vGS puede ser opuesta a la de la fuente de tensión del drenaje.
Cuando se selecciona el punto de operación, no hay tensión de polaridad opuesta disponible de la fuente para cumplir con los requerimientos del circuito. Puede ser necesario descartar R2 de manera que solo se obtenga una tensión de la polaridad correcta. No siempre es posible encontrar valores de un resistor para lograr un punto Q en particular. En tales casos, seleccionar un nuevo punto Q puede proporcionar a veces una solución al problema.
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CONCLUSION
Los transistores FET realizan la función de control de la corriente, común a todos los transistores por ser característica básica, mediante una tensión aplicada en uno de sus terminales. Están construidos con una zona semiconductora tipo P o N que une dos de sus tres terminales. El comportamiento de los transistores de efecto de campo se caracteriza por sus curvas características en las que se representa la corriente que entra o sale por el Drenador en función de la tensión aplicada entre éste y la Fuente. Estos transistores pueden ser empleados en los circuitos en una disposición similar a la de los bipolares, es decir, en fuente común, aunque la primera y la última son las más utilizadas en la practica. En época reciente ha aparecido en el mercado una nueva tecnología de fabricación de transistores MOS que reciben el nombre de VMOS a causa de la estructura geométrica de sus diferentes regiones semiconductoras. Se emplean en amplificadores de potencia así como en conmutación, haciendo la función de interruptor, gracias a la baja resistencia interna que poseen.